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Sdram 控制器

  • 资源大小:14.83 kB
  • 上传时间:2021-06-30
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  • 标      签: Verilog verilog sdram 控制器

资 源 简 介

在 verilog 代码 sdram 控制器. 在 first.rar-- matlab 代码是在 first.rar 为接收器分布给出了在 MATLAB 文件 clockTreeAssignment.m 中找到零偏差时钟直线树。 发现从根源到汇的延迟 (时钟延迟)。使用埃尔莫尔延迟-model(i.e no need to do SPICE simulation) 请点击左侧文件开始预览 !预览只提供20%的代码片段,完整代码需下载后查看 加载中 侵权举报

文 件 列 表

TestBench
sdram_top_TB.vhd
sdram_top_TB_runtest.do
mt48lc2m32b2_2.vhd
SDR_CTRL.vhd
SDRAM_32.vhd
sdram_top.vhd
VIP VIP
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