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Nexys 4 7 段显示器

  • 资源大小:147.19 kB
  • 上传时间:2021-06-30
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  • 标      签: Verilog verilog 显示器 Nexys

资 源 简 介

这是一个简单的方式来创建一个 verilog 模块为 7 段的目的,是很容易阅读和它可以测试您的 nexys 4 对 FPGA。

文 件 列 表

Pr谩ctica 2
build
project.ngc_xst.xrpt
Makefile
top.ucf
selector.v
top.bit
counter.v
top.v
encoder.v
build
top_map.xrpt
VIP VIP
0.181645s