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异步FIFO的verilog代码

  • 资源大小:24.21 kB
  • 上传时间:2021-06-30
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  • 标      签: Verilog

资 源 简 介

本代码是异步FIFO的VERILOG HDL代码,代码除了实现基本的异步FIFO跨时钟域数据传输以外,代码简单易读,可以作为笔试或者面试手写代码的备考代码,本人华为FPGA逻辑开发工程师岗位面试手写的异步FIFO程序就是出自本代码

文 件 列 表

asynchorou_fifo_study
asynchorous_fifo.cmd_log
asynchorous_fifo.lso
asynchorous_fifo.prj
asynchorous_fifo.syr
asynchorous_fifo.v
asynchorous_fifo.xst
asynchorous_fifo_envsettings.html
asynchorous_fifo_summary.html
asynchorous_fifo_xst.xrpt
asynchorou_fifo_study.gise
asynchorou_fifo_study.xise
ipcore_dir
iseconfig
webtalk_pn.xml
xst
_xmsgs
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