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三态总线 GPIO

  • 资源大小:1.12 kB
  • 上传时间:2021-06-30
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  • 标      签: Verilog verilog gpio 总线

资 源 简 介

(1) 与微处理器可编程三态总线接口 GPIO (通用目的输入和输出端口)(2) 总线接口:1.addr_reg: 地址总线2.rd_n_reg、 wr_n_reg、 cs_n_reg: 控制总线3.数据: 三态数据总线(3) 内部寄存器:

文 件 列 表

tristatebus_gpio.v
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