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verilog hdl coding DDR sdram control for fpga

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  • 上传时间:2021-06-30
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资 源 简 介

verilog hdl coding DDR sdram control for fpga -verilog hdl coding DDR sdram control for fpga

文 件 列 表

ddr_ctrl
.svn
text-base
ddr_top.v.svn-base
ddr_top.v
ddr_par.v
ddr_sig.v
ddr_ctrl.v
ddr_data.v
.svn
VIP VIP
0.178615s