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Serial to parallel conversion code

  • 资源大小:1.58 kB
  • 上传时间:2021-06-30
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  • 标      签: VHDL

资 源 简 介

用于串行到并行数据转换器的VHDL代码;当输入数据是串行的时,该代码是用于许多应用程序的位到字节转换的VHDL代码形成代码使用基于FPGA的LUT和D-RAM来存储数据,然后用时钟推送字节对齐的数据。

文 件 列 表

SerToPar_Conv.vhd
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