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基于verilog的串口收发协议

资 源 简 介

基于verilog的串口收发程序,使用组合逻辑加时序逻辑的方式编写,易于灵活修改!

文 件 列 表

RS232_RX
db
RS232_RX.qpf
RS232_RX.qsf
RS232_RX.qws
RS232_RX.v
RS232_TX
simulation
incremental_db
db
RS232_TX.asm.rpt
RS232_TX.done
RS232_TX.eda.rpt
RS232_TX.fit.rpt
RS232_TX.fit.smsg
RS232_TX.fit.summary
RS232_TX.flow.rpt
RS232_TX.map.rpt
RS232_TX.map.summary
RS232_TX.pin
RS232_TX.pof
RS232_TX.qpf
RS232_TX.qsf
RS232_TX.qws
RS232_TX.sof
RS232_TX.tan.rpt
RS232_TX.tan.summary
RS232_TX.v
RS232_TX.v.bak
RS232_TX_nativelink_simulation.rpt
RS232_TX_tb.v
RS232_TX_tb.v.bak
VIP VIP
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