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• 开发环境：maxplus2 a/d convortor
• 程序采用VHDL：频率合成DDS主要调用LPM，
• A &quot percentage of seconds, seconds, minutes,&quot digital stopwatch timer c...
• Asynchronous FIFO controller Verilog Design and Implementation
• This is a use of the VHDL language Parallel to Serial procedures, In altera deve...
• ZBT-sram控制器VHDL.doc
• 在USB contreoller CRC5块
• 用VHDL设计CRC发生器和校验器，供初学者参考。

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• 这个是BRISTOL大学 大二的作业. 当时得了90多分所以如果有国外留学生朋友可以看看....

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