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FPGA数码管时钟显示

资 源 简 介

FPGA时钟显示程序,可以按照正常的时间,频率可调,数码管显示00-00-00,中间的-可改。只要采用嵌套的循环结构实现

文 件 列 表

Clock
db
incremental_db
simulation
clock.asm.rpt
clock.cdf
clock.done
clock.eda.rpt
clock.fit.rpt
clock.fit.smsg
clock.fit.summary
clock.flow.rpt
clock.jdi
clock.map.rpt
clock.map.summary
clock.pin
clock.qpf
clock.qsf
clock.sof
clock.sta.rpt
clock.sta.summary
clock.v
clock.v.bak
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0.198841s