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verilog 控制ad7705读写

  • 资源大小:576.07 kB
  • 上传时间:2021-06-30
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  • 标      签: Verilog

资 源 简 介

ad7705通过spi时序进行读写,通过fpga模拟spi时序对adc进行读写,首先写入通信寄存器20h,时钟寄存器0C,通信寄存器10,设置寄存器40H,然后写通信寄存器进行读取。

文 件 列 表

ADCtest
db
cmp_state.ini
M10MHz.bsf
M10MHz.vhd
SetData.bsf
SetData.vhd
test.asm.rpt
test.bdf
test.cdf
test.done
test.fit.eqn
test.fit.rpt
test.fit.summary
test.flow.rpt
test.map.eqn
test.map.rpt
test.map.summary
test.pin
test.pof
test.ppl
test.qpf
test.qsf
test.qws
test.sof
test.tan.rpt
test.tan.summary
VIP VIP
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