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mealyfsm sequence detector

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  • 上传时间:2021-06-30
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  • 标      签: Verilog verilog

资 源 简 介

有限状态机(FSM)或有限状态自动机(复数:自动机),或简称状态机,是用于设计计算机程序和时序逻辑电路的计算数学模型。它被认为是一个抽象的机器,可以处于有限个状态之一。机器一次只处于一种状态;它在任何给定时间处于的状态称为当前状态。当tr启动时,它可以从一种状态改变到另一种状态

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