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SPI模块的Verilog HDL源代码

资 源 简 介

本代码用VERILOG HDL语言编写了SPI模块,通过用modelsim进行仿真,得到了正确的仿真结果,并将其下载到fpga开发板上进行试验,也得到了较好的效果。

文 件 列 表

spi
spi.pdf
spi_clgen.v
spi_defines.v
spi_shift.v
spi_top.v
tb
timescale.v
VIP VIP
0.213914s