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UART串口协议HDL实现,可设波特率、停止位和奇偶校验等

  • 资源大小:2.32 kB
  • 上传时间:2021-06-30
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  • 标      签: Verilog

资 源 简 介

UART串口协议HDL实现,可设波特率、停止位和奇偶校验等。可以在此基础上添加FIFO,以及处理器读写控制等。

文 件 列 表

uart_phy.v
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