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veriloge计算

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  • 上传时间:2021-06-30
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  • 标      签: Verilog

资 源 简 介

1.設計一計數器,計算輸入信號(pulse)的高準位有多少個時脈週期,並將計數結果輸出至(cnt_value)。2.使用hw1_tb.v當Top level Testbench 。3.注意cnt_value只能在每次輸入信號(pulse)負緣後變化一次。 

文 件 列 表

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