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booth乘法器verilog源代码

  • 资源大小:11.67 kB
  • 上传时间:2021-06-30
  • 下载次数:0次
  • 浏览次数:0次
  • 资源积分:1积分
  • 标      签: Verilog

资 源 简 介

源文件中的代码是基于BOOTH2算法的32位乘法器,并且采用了4:2压缩器,并且进行了实际的仿真,直接运行就可以通过,代码通俗易懂,具有很好的参考意义,可以供初学者使用和参考。欢迎大家下载!

文 件 列 表

代码
Booth2.v
compressor4_2.v
generate_PPi.v
testbench.v
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