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FPGA的设计,VHDL编程,Max Plus模拟,在实际电路验证…

资 源 简 介

FPGA数字钟的设计,用VHDL语言编程,max+plus仿真,可在实际电路中验证-FPGA design, VHDL programming, max plus simulation, in the actual circuit verification

文 件 列 表

硬件描述语言VHDL
wy
clk7.txt
program-h.txt
program-m.txt
program-s.txt
six choose one.txt
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