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开源软核处理器OpenRisc的SOPC设计

资 源 简 介

开源软核处理器OpenRisc的SOPC设计

文 件 列 表

wb_conbusex
syn
sim
rtl
bench
or1200-1.35
bench
verilog
timescale.v
rtl
sim
rtl_sim
modelsim_sim
modelsim.ini
syn
quartus
EP2C35
cmp_state.ini
bench
rtl
sim
syn
bench
verilog
or1200_top_bench.v
or1200-1.35
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